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數(shù)字IC設(shè)計及EDA應(yīng)用 
定 價：89.8 元
9 7 6 8 1 7 0 1 5 1 0 5 8 讀者對象:本書面向集成電路設(shè)計與集成系統(tǒng)、微電子科學(xué)與工程高年級本科生和相關(guān)專業(yè)低年級研究生以及有一定Verilog HDL語言基礎(chǔ), 未來愿意從事數(shù)字IC設(shè)計的科技人員
本書針對基于標準單元的大規(guī)模數(shù)字集成電路設(shè)計, 介紹自頂向下的設(shè)計方法和設(shè)計流程, 用Verilog HDL描述數(shù)字集成電路時常用的規(guī)范、設(shè)計模式與設(shè)計方法, 以及數(shù)字IC設(shè)計流程中Linux/Solaris平臺上主流的EDA工具, 包括: 仿真工具NC-verilog/VCS、邏輯綜合工具Design Compiler、靜態(tài)時序分析工具PrimeTime、形式化驗證工具Formality、工具命令語言TCL以及ICC編譯工具等。
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